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FPGA를 위한 Hardware Programmer의 개발
송호정(Song Ho-jeong),이범근(Lee Beom-geun),박준선(Park Jun-seon),김현기(Kim Hyun-gi),이천희(Yi Cheon-hee) 한국정보과학회 1996 한국정보과학회 학술발표논문집 Vol.23 No.1A
FPGA에 원하는 회로를 구현하기 위해서는 FPGA의 스위칭 소자들을 프로그래밍 하는 장치가 필요한데 이를 하드웨어 프로그래머(Hardware Programmer)라 한다. 이 하드웨어 프로그래머는 프로그래밍 code를 입력으로 받아 프로그래밍에 필요한 전기적 신호를 FPGA 칩의 프로그래밍 단자에 가하여 스위칭 소자들을 도통시킨다. 즉, 프로그래밍 code를 FPGA원판 내부의 스위칭 소자를 프로그램 할 수 있도록 bit steam으로 변환하여 하드웨어 프로그래머로 전달하고, 하드웨어 프로그래머는 상위 computer로부터 FPGA의 프로그램 data를 전송 받아 blank 상태의 FPGA에 전송된 data를 순차적으로 write 시키고 검색하여 사용자가 원하는 상태의 custom IC로 만들게 된다. 본 논문에서는 antifuse 스위칭 소자를 사용하여 제작된 FPGA를 프로그래밍하는 하드웨어 프로그래머를 개발하였다.
송호정(Song Ho-jeong),이범근(Lee Beom-geun),김현기(Kim Hyun-gi),신원철(Shin Won-chol),하기종(Ha Ki-jong),이천희(Yi Cheon-hee) 한국정보과학회 1996 한국정보과학회 학술발표논문집 Vol.23 No.2B
VLSI 디자인 알고리즘의 실행시간은 디자인 문제의 크기보다 더 빠른 비율로 늘어나고 있으며 성능 향상의 가장좋은 방도는 병렬 처리방법을 사용하는 것이다. 대부분의 설계문제들은 완전 그래프 상에서 최적문제로 감소될 수 있으며 다항식의 기간내에서 정확하게 풀릴 수 있다. 교번(Alternative)방식은 다중 프로세서들이 최적화 문제의 조합상태 공간을 동시에 탐색하는데 사용되는 곳에서 병렬로 부작위로 탐색하는데 사용된다. 본 논문에서는 구간 그래프와 교환 그래프 상에서 최적화 문제들에 대한 병렬 알고리즘에 대하여 기술하였다.
김현기 ( Hyun-gi Kim ),송호정 ( Ho-jeong Song ),이범근 ( Beom-geun Lee ) 한국정보처리학회 2005 한국정보처리학회 학술대회논문집 Vol.12 No.1
채널 배선은 VLSI 설계 과정중의 하나로, 글로벌 배선을 수행한 후 각 배선 영역에 할당된 네트들을 트랙에 할당하여 구체적인 네트들의 위치를 결정하는 문제이며, 네트들이 할당된 트랙의 수를 최소화하는 문제이다. 본 논문에서는 4-레이어 채널 배선 문제에 대하여 효율적인 유전자 알고리즘(genetic algorithm; GA)을 이용한 해 공간 탐색(solution space search) 방식을 제안하였으며, 제안한 방식을 기존의 4-레이어 채널 배선 알고리즘과 비교, 분석하였다.
이범근,홍주선,정연모 경희대학교 산학협력기술연구원 1999 산학협력기술연구논문집 Vol.5 No.-
The purpose of format conversion is to convert a wide range of personal computer video formats to a target format. Circuits for the conversion have been developed by means of interpolation techniques, such as zero-order interpolation, bilinear interpolation, and bisigmoidal Interpolation. This paper purposes an adaptive scan converter using bisigmoidal interpolation The value of the control constant of the bisigmoidal interpolation polynomial is adaptively selected according to the difference of neighboring pixel values for a new pixel on the target format. The converter has been modeled in VHDL, on Max+PlusⅡ and implemented with a FPGA chip. The circuit gives much better conversion performance than a scan converter with a fixed control constant based on the bisigmoidal interpolation.