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      Design of NAND Flash Memory Device by the Fringing Field from a Control Gate

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      https://www.riss.kr/link?id=A104323391

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      다국어 초록 (Multilingual Abstract)

      We propose a cell structure with non-overlap source/drain (S/D) (or without S/D) for a NAND flash memory, which utilizes the fringing field from control gates. In this work, a guideline for the cell device design is suggested through extensive device simulations. We considered a cell string with conventional SONOS cell transistors that have a nitride storage node on a planar channel structure. The read operation of an erased cell in the proposed cell string was successful, which is an important issue for a device using a fringing field. We think that our proposed structure is a promising candidate to improve scalability for sub-40 nm NAND flash memory because the proposed devices show better characteristics with scaling down.
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      We propose a cell structure with non-overlap source/drain (S/D) (or without S/D) for a NAND flash memory, which utilizes the fringing field from control gates. In this work, a guideline for the cell device design is suggested through extensive device ...

      We propose a cell structure with non-overlap source/drain (S/D) (or without S/D) for a NAND flash memory, which utilizes the fringing field from control gates. In this work, a guideline for the cell device design is suggested through extensive device simulations. We considered a cell string with conventional SONOS cell transistors that have a nitride storage node on a planar channel structure. The read operation of an erased cell in the proposed cell string was successful, which is an important issue for a device using a fringing field. We think that our proposed structure is a promising candidate to improve scalability for sub-40 nm NAND flash memory because the proposed devices show better characteristics with scaling down.

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      참고문헌 (Reference)

      1 S. Thompson, 132-, 1998

      2 H. Lee, E85-C : 1079-, 2002

      3 I. H. Cho, 133-, 2003

      4 K. R. Han, 45 : 1027-, 2006

      5 "ITRS 2006 edition"

      6 Sung Kim, "Structural and Optical Characterization of Ge Nanocrystals Showing Large Nonvolatile Memories in Metal-Oxide-Semiconductor Structures" 한국물리학회 49 (49): 959-962, 2006

      7 Yukiharu Uraoka, "New Fabrication Technique Using Side-Wall-Type Plasma-Enhanced Chemical-Vapor Deposition for a Floating Gate Memory with a Si Nanodot" 한국물리학회 49 (49): 569-576, 2006

      8 Do-Hyun Oh, "Electron and Hole Storage in a Floating Gate Consisting of Si Nanocrystals Embedded in a SiO2 Layer" 한국물리학회 50 (50): 1755-1759, 2007

      9 Il Hwan Cho, "Body-Tied Double-Gate SONOS Flash (Omega Flash) Memory Device Built on a Bulk Si Wafer" 한국물리학회 44 (44): 83-86, 2004

      10 SILVACO International, "ATLAS User's Manual"

      1 S. Thompson, 132-, 1998

      2 H. Lee, E85-C : 1079-, 2002

      3 I. H. Cho, 133-, 2003

      4 K. R. Han, 45 : 1027-, 2006

      5 "ITRS 2006 edition"

      6 Sung Kim, "Structural and Optical Characterization of Ge Nanocrystals Showing Large Nonvolatile Memories in Metal-Oxide-Semiconductor Structures" 한국물리학회 49 (49): 959-962, 2006

      7 Yukiharu Uraoka, "New Fabrication Technique Using Side-Wall-Type Plasma-Enhanced Chemical-Vapor Deposition for a Floating Gate Memory with a Si Nanodot" 한국물리학회 49 (49): 569-576, 2006

      8 Do-Hyun Oh, "Electron and Hole Storage in a Floating Gate Consisting of Si Nanocrystals Embedded in a SiO2 Layer" 한국물리학회 50 (50): 1755-1759, 2007

      9 Il Hwan Cho, "Body-Tied Double-Gate SONOS Flash (Omega Flash) Memory Device Built on a Bulk Si Wafer" 한국물리학회 44 (44): 83-86, 2004

      10 SILVACO International, "ATLAS User's Manual"

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      KCIF(4년) KCIF(5년) 중심성지수(3년) 즉시성지수
      0.26 0.2 0.26 0.03
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