양자논리회로의 가역성은 정보 가역적 및 에너지 가역적 회로라는 두 가지 가역 조건을 만족할 때 실현될 수 있다. 본 논문은 다치 양자논리 회로에서 원래상태로의 정보가역성 회복에 필요...
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2017
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567
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학술저널
189-194(6쪽)
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양자논리회로의 가역성은 정보 가역적 및 에너지 가역적 회로라는 두 가지 가역 조건을 만족할 때 실현될 수 있다. 본 논문은 다치 양자논리 회로에서 원래상태로의 정보가역성 회복에 필요...
양자논리회로의 가역성은 정보 가역적 및 에너지 가역적 회로라는 두 가지 가역 조건을 만족할 때 실현될 수 있다. 본 논문은 다치 양자논리 회로에서 원래상태로의 정보가역성 회복에 필요한 연산 사이클을 모델링하였다. 모델링을 위해 유니터리 스위치를 산술 멱승 스위치로 사용하는 함수 임베딩 방법을 사용하였다. 양자논리회로에서 수반게이트 쌍이 대칭이면 유니터리 스위치함수가 균형함수 특성을 보임으로써 원래상태의 정보 가역성 회복에 1 사이클 연산이 소요되었다. 반대로 비대칭 구조이면 상수 함수에 의해 2 사이클 연산이 소요되었다. 본 논문은 ternary M-S 게이트로 hybrid MCT 게이트를 실현할 경우의 비대칭 구조에 따른 2 사이클 복원 문제는 비대칭 구조의 수반게이트들을 대칭구조의 수반게이트로 등가 변환하여 해결할 수 있음을 밝혔다.
다국어 초록 (Multilingual Abstract)
The reversibility of a quantum logic circuit can be realized when two reversible conditions of information reversible and energy reversible circuits are satisfied. In this paper, we have modeled the computation cycle required to recover the informatio...
The reversibility of a quantum logic circuit can be realized when two reversible conditions of information reversible and energy reversible circuits are satisfied. In this paper, we have modeled the computation cycle required to recover the information reversibility from the multivalued quantum logic to the original state. For modeling, we used a function embedding method that uses a unitary switch as an arithmetic exponentiation switch. In the quantum logic circuit, if the adjoint gate pair is symmetric, the unitary switch function shows the balance function characteristic, and it takes 1 cycle operation to recover the original information reversibility. Conversely, if it is an asymmetric structure, it takes two cycle operations by the constant function. In this paper, we show that the problem of 2-cycle restoration according to the asymmetric structure when the hybrid MCT gate is realized with the ternary M-S gate can be solved by equivalent conversion of the asymmetric gate to the gate of the symmetric structure.
목차 (Table of Contents)
참고문헌 (Reference)
1 박동영, "의사-제어된 NCV 게이트로 실현된 매크로 양자회로의새로운 함수 합성법" 한국전자통신학회 9 (9): 447-454, 2014
2 박동영, "가역 임베딩 없는 직접적 비가역-가역회로 매핑 방법의 게이트비용 절감 방안" 한국전자통신학회 9 (9): 1233-1240, 2014
3 B. Mondal, "Synthesis of Balanced Ternary Reversible Logic Circuit" 334-339, 2013
4 S. Sultana, "Rev-Map: A Direct Gateway from Classical Irreversible Network to Reversible Network" 147-152, 2011
5 Z. Sasanian, "Realizing reversible circuits using a new class of quantum gates" 36-41, 2012
6 C. Moraga, "On some Basic Aspects of Ternary Reversible and Quantum Computing" 178-183, 2014
7 박동영, "NCV-|v1>라이브러리의 새로운 쌍대 구조와 응용" 한국전자통신학회 11 (11): 165-170, 2016
8 박동영, "NCV-|v1>라이브러리를 이용한 Mixed-Polarity MCT 게이트 실현" 한국전자통신학회 11 (11): 29-36, 2016
9 M. Perkowski, "Design of Regular Reversible Quantum Circuits" LAP LAMBERT Academic Publishing 2011
10 M. Lukac, "Analysis of Faults in Reversible Computing" 115-120, 2014
1 박동영, "의사-제어된 NCV 게이트로 실현된 매크로 양자회로의새로운 함수 합성법" 한국전자통신학회 9 (9): 447-454, 2014
2 박동영, "가역 임베딩 없는 직접적 비가역-가역회로 매핑 방법의 게이트비용 절감 방안" 한국전자통신학회 9 (9): 1233-1240, 2014
3 B. Mondal, "Synthesis of Balanced Ternary Reversible Logic Circuit" 334-339, 2013
4 S. Sultana, "Rev-Map: A Direct Gateway from Classical Irreversible Network to Reversible Network" 147-152, 2011
5 Z. Sasanian, "Realizing reversible circuits using a new class of quantum gates" 36-41, 2012
6 C. Moraga, "On some Basic Aspects of Ternary Reversible and Quantum Computing" 178-183, 2014
7 박동영, "NCV-|v1>라이브러리의 새로운 쌍대 구조와 응용" 한국전자통신학회 11 (11): 165-170, 2016
8 박동영, "NCV-|v1>라이브러리를 이용한 Mixed-Polarity MCT 게이트 실현" 한국전자통신학회 11 (11): 29-36, 2016
9 M. Perkowski, "Design of Regular Reversible Quantum Circuits" LAP LAMBERT Academic Publishing 2011
10 M. Lukac, "Analysis of Faults in Reversible Computing" 115-120, 2014
11 M. Bellac, "A Short Introduction to Quantum Information and Quantum Computing" Cambridge University Press 2006
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학술지 이력
연월일 | 이력구분 | 이력상세 | 등재구분 |
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2026 | 평가예정 | 재인증평가 신청대상 (재인증) | |
2020-01-01 | 평가 | 등재학술지 유지 (재인증) | |
2017-01-01 | 평가 | 등재학술지 선정 (계속평가) | |
2016-01-01 | 평가 | 등재후보학술지 유지 (계속평가) | |
2015-01-01 | 평가 | 등재후보학술지 유지 (계속평가) | |
2013-01-01 | 평가 | 등재후보 1차 FAIL (등재후보1차) | |
2012-01-01 | 평가 | 등재후보학술지 유지 (기타) | |
2011-01-01 | 평가 | 등재후보 1차 PASS (등재후보1차) | |
2009-01-01 | 평가 | 등재후보학술지 선정 (신규평가) | |
2007-08-27 | 학회명변경 | 한글명 : 학국전자통신학회 -> 한국전자통신학회영문명 : The Korea Insitute of Electronic Communication Sciences -> The Korea Institute of Electronic Communication Sciences |
학술지 인용정보
기준연도 | WOS-KCI 통합IF(2년) | KCIF(2년) | KCIF(3년) |
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2016 | 0.89 | 0.89 | 0.79 |
KCIF(4년) | KCIF(5년) | 중심성지수(3년) | 즉시성지수 |
0.77 | 0.76 | 0.698 | 0.27 |