- Abstract
- Ⅰ. 서론
- Ⅱ. 비데오코덱용 Source coder/decoder의 양자화 / 역양자화 과정
- Ⅲ. 고속 연산에 적합한 파이프라인 병렬처리형 양자화 / 역양자화기의 구조
- Ⅳ. 설계된 양자화 역양자화기의 구현
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1990
Korean
학술저널
489-493(5쪽)
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