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      순환 DFT에 기초한 동기 위상 측정 장치의 ASIC 구현 = An ASIC Implementation of Synchronized Phasor Measurement Unit based on Sliding-DFT

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      https://www.riss.kr/link?id=A76557420

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      목차 (Table of Contents)

      • Abstract
      • 1. 서론
      • 2. 순환 DFT에 기초한 페이저 연산 알고리즘과 오차 영향 해석
      • 3. 페이저 연산기의 곱셈기 공유 구조
      • 4. FPGA에 기초한 시스템 구현 및 시뮬레이션 결과
      • Abstract
      • 1. 서론
      • 2. 순환 DFT에 기초한 페이저 연산 알고리즘과 오차 영향 해석
      • 3. 페이저 연산기의 곱셈기 공유 구조
      • 4. FPGA에 기초한 시스템 구현 및 시뮬레이션 결과
      • 6. 결론
      • 감사의 글
      • 참고문헌
      • 저자소개
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