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An approach to computer-aided specification
Mueller-Glaser, K. D.Bortolazzi, J. IEEE 1990 p.335-345
An integrated switched-capacitor signal processing design system
Barlow, A. R.;Takasuka, K.;Nambu, Y.;Adachi, T.;Konno, J. I.;Nishimoto, M.;Suzuki, S.;Nemoto, K.Takashima, K. IEEE 1990 p.346-352
Simulation techniques for mixed analog/digital circuits
Acuna, E. L.;Dervenis, J. P.;Pagones, A. J.;Yang, F. L.Saleh, R. A. IEEE 1990 p.353-363
A bit-serial VLSI array processing chip for image processing
Heaton, R.;Blevins, D.Davis, E. IEEE 1990 p.364-368
A four-processor building block for SIMD processor arrays
Fisher, A. L.;Highnam, P. T.Rockoff, T. E. IEEE 1990 p.369-375
A VLSI fuzzy logic controller with reconfigurable, cascadable architecture
Watanabe, H.;Dettloff, W. D.Yount, K. E. IEEE 1990 p.376-382
A data-path multiplier with automatic insertion of pipeline stages
Asato, C.;Ditzen, C.Dholakia, S. IEEE 1990 p.383-387
A 3.8-ns CMOS 16*16-b multiplier using complementary pass-transistor logic
Yano, K.;Yamanaka, T.;Nishida, T.;Saito, M.;Shimohigashi, K.Shimizu, A. IEEE 1990 p.388-395
Mixed static and domino logic on the CMOS gate forest
Kernhof, J.;Selzer, M.;Beunder, M. A.;Hoefflinger, B.;Laquai, B.Schindler, I. IEEE 1990 p.396-402
Hayashi, T.;Doi, T.;Asai, M.;Ishibashi, K.;Shukuri, S.;Watanabe, A.Suzuki, M. IEEE 1990 p.403-409
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