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Device Mismatch and Tradeoffs in the Design of Analog Circuits
Kinget, P. R. IEEE; 1998 2005 p.1212-1224
A 16-bit 65-MS/s 3.3-V Pipeline ADC Core in SiGe BiCMOS With 78-dB SNR and 180-fs Jitter
Zanchi, A.; Tsay, F. IEEE; 1998 2005 p.1225-1237
High-Speed High-Precision CMOS Analog Rank Order Filter With O(n) Complexity
Carvajal, R. G.; Ramirez-Angulo, J.; Ducoudray, G. O.; Lopez-Martin, A. J. IEEE; 1998 2005 p.1238-1248
A 110-MHz 84-dB CMOS Programmable Gain Amplifier With Integrated RSSI Function
Wu, C.-P.; Tsao, H.-W. IEEE; 1998 2005 p.1249-1258
A Low-Voltage Folded-Switching Mixer in 0.18-mum CMOS
Vidojkovic, V.; van der Tang, J.; Leeuwenburgh, A.; van Roermund, A. H. M. IEEE; 1998 2005 p.1259-1264
A 2.4-GHz RF Sampling Receiver Front-End in 0.18-mum CMOS
Jakonis, D.; Folkesson, K.; Dabrowski, J.; Eriksson, P.; Svensson, C. IEEE; 1998 2005 p.1265-1277
A 12-GHz Silicon Bipolar Dual-Conversion Receiver for Digital Satellite Applications
Copani, T.; Smerzi, S. A.; Girlando, G.; Palmisano, G. IEEE; 1998 2005 p.1278-1287
A 1.8-V Operation 5-GHz-Band CMOS Frequency Doubler Using Current-Reuse Circuit Design Technique
Yamamoto, K. IEEE; 1998 2005 p.1288-1295
A Low-Phase-Noise and Low-Power Multiband CMOS Voltage-Controlled Oscillator
Li, Z.; O, K. K. IEEE; 1998 2005 p.1296-1302
Modeling, Design and Characterization of a New Low-Jitter Analog Dual Tuning LC-VCO PLL Architecture
Nonis, R.; Da Dalt, N.; Palestri, P.; Selmi, L. IEEE; 1998 2005 p.1303-1309
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