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Highlights of the ISSCC 2013 Processors and High Performance Digital Sessions
Fischer, T.; Nam, B.; Chang, L.; Kuroda, T.; Pertijs, M. A. IEEE; 1998 2014 p.4-8
Circuit and Physical Design of the zEnterprise EC12 Microprocessor Chips and Multi-Chip Module
Warnock, J.; Chan, Y.; Harrer, H.; Carey, S.; Salem, G.; Malone, D.; Puri, R.; Zitz, J. A.; Jatkowski, A.; Strevig, G. IEEE; 1998 2014 p.9-18
A 3.6 GHz 16-Core SPARC SoC Processor in 28 nm
Hart, J. M.; Cho, H.; Ge, Y.; Gruber, G.; Huang, D.; Hwang, C.; Jian, D.; Johnson, T.; Konstadinidis, G. K.; Krishnaswamy, V. IEEE; 1998 2014 p.19-31
The 10th Generation 16-Core SPARC64 Processor for Mission Critical UNIX Server
Kan, R.; Tanaka, T.; Sugizaki, G.; Ishizaka, K.; Nishiyama, R.; Sakabayashi, S.; Koyanagi, Y.; Iwatsuki, R.; Hayasaka, K.; Uemura, T. IEEE; 1998 2014 p.32-40
An 8-Core MIPS-Compatible Processor in 32/28 nm Bulk CMOS
Hu, W.; Yang, L.; Fan, B.; Wang, H.; Chen, Y. IEEE; 1998 2014 p.41-49
A Compact, Low-Power and Low-Jitter Dual-Loop Injection Locked PLL Using All-Digital PVT Calibration
Musa, A.; Deng, W.; Siriburanon, T.; Miyahara, M.; Okada, K.; Matsuzawa, A. IEEE; 1998 2014 p.50-60
A 249-Mpixel/s HEVC Video-Decoder Chip for 4K Ultra-HD Applications
Tikekar, M.; Huang, C. T.; Juvekar, C.; Sze, V.; Chandrakasan, A. P. IEEE; 1998 2014 p.61-72
An LDPC Decoder With Time-Domain Analog and Digital Mixed-Signal Processing
Miyashita, D.; Yamaki, R.; Hashiyoshi, K.; Kobayashi, H.; Kousai, S.; Oowaki, Y.; Unekawa, Y. IEEE; 1998 2014 p.73-83
Whatmough, P. N.; Das, S.; Bull, D. M. IEEE; 1998 2014 p.84-94
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