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Low-Voltage 1.9-GHz Front-End Receiver in 0.5-mum CMOS Technology
Abou-Allam, E. IEEE; 1998 2001 p.1434-1443
A Supply-Noise-Insensitive CMOS PLL With a Voltage Regulator Using DC-DC Capacitive Converter
Lee, C.-H. IEEE; 1998 2001 p.1453-1463
A Fast-Lock Mixed-Mode DLL Using a 2-b SAR Algorithm
Dehng, G.-K. IEEE; 1998 2001 p.1464-1471
Triple-Push Oscillator Approach: Theory and Experiments
Tang, Y.-L. IEEE; 1998 2001 p.1472-1479
Exploiting CMOS Reverse Interconnect Scaling in Multigigahertz Amplifier and Oscillator Design
Kleveland, B. IEEE; 1998 2001 p.1480-1488
An 8-bit 80-Msample/s Pipelined Analog-to-Digital Converter With Background Calibration
Ming, J. IEEE; 1998 2001 p.1489-1497
A CMOS 400-Mb/s Serial Link for AS-Memory Systems Using a PWM Scheme
Chen, W.-H. IEEE; 1998 2001 p.1498-1505
Low-Power and High-Speed ROM Modules for ASIC Applications
Chang, C.-R. IEEE; 1998 2001 p.1516-1523
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