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Mattausch, H. J. INSTITUTE OF ELECTRONICS, INFORMATION & 2001 IEICE transactions on electronics Vol.84 No.3
Circuit Simulation Models for Coming MOSFET Generations
Miura-Mattausch, M., Ueno, H., Mattausch, H. J., K INSTITUTE OF ELECTRONICS, INFORMATION & 2002 IEICE transactions on fundamentals of electronics, Vol.E85-A No.4
Compact Associative-Memory Architecture With Fully Parallel Search Capability for the Minimum Hamming Distance
Mattausch, H. J., Gyohten, T., Soda, Y., Koide, T. IEEE; 1998 2002 IEEE journal of solid-state circuits Vol.37 No.2
Application of port-access-rejection probability theory for integrated N-port memory architecture optimisation
Mattausch, H. J. IEE 1998 Electronics Letters Vol.34 No.9
HiSIM2 Circuit simulation - Solving the speed versus accuracy crisis
Mattausch, H. J., Miyake, M., Yoshida, T., Hazama, IEEE PERIODICALS 2006 IEEE circuits and devices magazine Vol.22 No.5
Hierarchical architecture for area-efficient integrated N-port memories with latency-free multi-gigabit per second access bandwidth
Mattausch, H. J [Institution of Electrical Engineers] 1999 Electronics Letters Vol.35 No.17
Fully-Parallel Pattern-Matching Engine with Dynamic Adaptability to Hamming or Manhattan Distance
Mattausch, H. J.,Omori, N.,Fukae, S.,Koide, T.,Gyo Widerkehr and Associates 2002 SYMPOSIUM ON VLSI CIRCUITS Vol.- No.-
Mattausch, H. J [Institution of Electrical Engineers] 1998 Electronics Letters Vol.34 No.9
Multiplet structure of P-excitons in CuBr due to valence band degeneracy
H.J. Mattausch, Ch. Uihlein Pergamon Press 1978 Solid state communications Vol.25 No.7
MOSFET modeling gets physical
Miura-Mattausch, M., Mattausch, H.J., Arora, N.D. IEEE 2001 IEEE circuits and devices magazine Vol.17 No.6
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