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A 33-mW 8-Gb/s CMOS Clock Multiplier and CDR for Highly Integrated I
Farjad-Rad, R., Nguyen, A., Tran, J. M., Greer, T. IEEE; 1998 2004 IEEE journal of solid-state circuits Vol.39 No.9
A 0.4(m CMOS 10-Gb/s 4-PAM Pre-Emphasis Serial Link Transmitter
Farjad-Rad, R., Yang, C.-K. K., Horowitz, M., Lee, IEEE 1998 SYMPOSIUM ON VLSI CIRCUITS Vol.6 No.-
A 0.3-mum CMOS 8-Gb/s 4-PAM Serial Link Transceiver
Farjad-Rad, R. IEEE; 1998 2000 IEEE journal of solid-state circuits Vol.35 No.5
A 0.3-� CMOS 8-Gb/s 4-PAM Serial Link Transceiver
Farjad-Rad, R.,Yang, C.-K. K.,Horowitz, M.,Lee, T. IEEE 1999 SYMPOSIUM ON VLSI CIRCUITS Vol.6 No.-
A 0.4-� CMOS 10-Gb/s 4-PAM Pre-Emphasis Serial Link Transmitter
Farjad-Rad, R. IEEE INSTITUTE OF ELECTRICAL AND ELECTRONICS 1999 IEEE journal of solid-state circuits Vol.34 No.5
A Low-Power Multiplying DLL for Low-Jitter Multigigahertz Clock Generation in Highly Integrated Digital Chips
Farjad-Rad, R.,Dally, W.,Ng, H.-T.,Senthinathan, R IEEE 2002 IEEE journal of solid-state circuits Vol.37 No.12
Farjad-Rad, R., Dally, W., Ng, H.-T., Senthinathan IEEE; 1998 2002 IEEE journal of solid-state circuits Vol.37 No.12
A Second-Order Semidigital Clock Recovery Circuit Based on Injection Locking
Ng, H.-T., Farjad-Rad, R., Lee, M.-J. E., Dally, W IEEE; 1998 2003 IEEE journal of solid-state circuits Vol.38 No.12
A 0.6� CMOS 4Gb/s Transceiver with Data Recovery Using Oversampling
Yang, C.-K. K., Farjad-Rad, R., Horowitz, M. IEEE 1997 SYMPOSIUM ON VLSI CIRCUITS Vol.6 No.-
Developing a train timetable according to track maintenance plans: A stochastic optimization of buffer time schedules
Bababeik, Mostafa, Zerguini, Seghir, Farjad-Amin, Elsevier Science B.V., Amsterdam 2019 Transportation research procedia Vol.37 No.-
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